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基于故障注入的基准电路故障响应分析

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俞振华 江建慧

同济大学电子信息与工程学院,上海200092

现代电子技术
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国际标准刊号:ISSN 1004-373X
国内统一刊号:CN 61-1224

摘  要:

为了提高集成电路的成品率,试图采用更简便有效的方法测试芯片,并获得反映电路特性的故障响应率,在进行电路功能仿真(前仿真)或电路时序仿真(后仿真)的过程中,对电路注入单故障或多故障,然后在电路存在故障的情况下,模拟电路的行为,获得电路的故障响应率。实现了一个通用的数字电路“故障响应分析”程序,他模拟电路注入故障,收集模拟结果,通过分析获取电路的故障响应率。[著者文摘]

circuit;fault response rate;single fault;double faults 1 研究背景2 故障与故障注入随着半导体器件的尺寸不断缩小,集成电路(IC)设计的规模越来越大,芯片集成度越来越高,使得芯片测试越来越困难。为了提高集成电路的成品率,研究人员把更多的精力放在芯片的测试技术上,试图采用更简便有效的方法测试芯片,并获得满足要求的故障覆盖率。电路故障覆盖率的评测方法可以在芯片制造完成后,通过自动测试仪(ATE)获得芯片的故障覆盖率。这种方法是一种事后的评估行为,他只能对成品芯片的优劣做出估计,不能对改进芯片设计起到至关重要的作用。另一种获得故障覆盖率的方法是,设计或测试人员在进行电路功能仿真(前仿真)或电路时序仿真(后仿真)的过程中,对电路注入单故障或多故障,然后在电路存在故障的情况下,模拟电路的行为,确认该故障是否会导致电路产生差错或失效。对所选定的故障集中的所有故障进行模拟后,就可以获得电路的故障覆盖率。对于......
Modern Electronic Technique

栏目信息:

电路设计

分 类 号:

TN710

文献标识码:

B

文章编号:

1004-373X(2008)04-006-03

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参考文献(5篇)  主题相关

[参考文献]

Analysis of Datum Circuit Fault Response Based on Fault Injection

YU Zhenhua,JIANG Jianhui (School of Electronics and Information,Tongji University,Shanghai,200092,China)

Abstract:

To improve the yield of integrate circuit, trying to test chips with simple and effective ways and get the desired fault response rate. When emulating the function or the timing of a circuit,it injects single fault or multiple faults. Then emulating the behavior of this circuit with fault injected to get the fault response rate. In this project,it implements a general program for analysis of fault response rate of digital circuits. Using this program, we can inject the faults automatically, collect the result of emulation, then get the fault response rate.[著者文摘]

Key words:

integrated circuit; fault response rate;single fault; double faults

收稿日期: 2007-09-13

作者简介:

俞振华:同济大学电信学院电子科学与技术系硕士研究生。 江建慧:同济大学电信学院计算机科学与技术系教授博士生导师。

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